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TEST BORRADO, QUIZÁS LE INTERESEFundamentos de Computadores. Tema 3

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Título del test:
Fundamentos de Computadores. Tema 3

Descripción:
Elija entre Verdadero y Falso

Autor:
AlbertoJoseBaza
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Fecha de Creación:
21/01/2017

Categoría:
Informática

Número preguntas: 20
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Temario:
Los errores blandos pueden deberse a problemas de la fuente de la alimentación o pequeñas emisiones radiactivas presentes en los materiales V F.
La memoria DRAM es un tipo de memoria asociativa V F.
La capacidad de una SAN tiene un límite tecnológico y a día de hoy solo puede alcanzar decenas de terabytes V F.
Aumentando el tamaño de la caché siempre aumentamos el rendimiento V F.
Actualmente los PCs usan un único tipo de memoria caché V F.
Actualmente la caché de nivel 1 se encuentra integrada en el microprocesador V F.
Las memorias DRAM necesitan ser refrescadas V F.
En el metodo de acceso a memoria -modo página- mientras no se cambie de página no necesitamos volver a presentar la dirección de fila (RAS no cambia) V F.
La cache necesita ser refrescada y precisa un tiempo de recarga V F.
Las memorias caché son más rápidas y costosas que las DRAM V F.
Existen diferentes políticas de reemplazo, pero en general todas ellas conllevan el mismo rendimiento V F.
Cada entrada (posición) de caché, contiene información sobre la validez de los datos, modificación de los mismos y por supuesto la marca o etiqueta para identificarlos V F.
Los métodos de acceso a memoria son: acceso secuencial, acceso directo, acceso aleatorio y asociativo. V F.
La detección de errores mediante las memorias con paridad asegura la utilización de un ancho de datos más grande que sin utilizar paridad. V F.
Generalmente, los distintos apartados del SO se mantienen en disco duro mientras que el ordenador esté encendido, dejando espacio en memoria RAM para programas más importantes V F.
Todos los elementos de almacenamiento están sujetos a errores V F.
Dependiendo del tipo de comprobación de errores que realice la memoria estas se clasifican en: memorias sin paridad o memorias con paridad. V F.
La memoria cache se puede organizar de tres formas: Por correspondencia directa, totalmente asociativa y asociativa por conjuntos V F.
La relación entre la longitud A de una dirección y el numero N de unidades direccionables es 2^N=A V F.
La memoria sin paridad no realiza comprobación de errores V F.
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